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FPGA VIH and VIL

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发表于 14-3-2012 10:59 AM | 显示全部楼层 |阅读模式
请问当Vin 超过 FPGA VIH(max)时,会带来什么影响呢???

example :

PCI standard = VIH Max = Vccio + 0.5 = 3.8 (Vccio = 3.3)

my device = VIH Max = Vccio + 0.2 = 3.2 (Vccio = 3.0, old device spec)

如果不会kill掉FPGA, 为何要放VIH(max)???

VIH(max) 是要用来做什么呢???
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发表于 27-8-2012 09:14 PM | 显示全部楼层
通常IO port 都有一些 protection diode.
VIH max 就是你最高可以去的 voltage.

如果 vcc = 3, VIH max  = 3+0.2 V.
当你的 VIH 高过 Vcc +0.2 时,  current 会flow 去 Vcc.
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